Circuit to read information from and write information into a memory cell array
Schaltungsanordnung zum Lesen und Schreiben von Information an einem Speicherzellenfeld
Object of the invention is accordingly to provide a semiconductor memory having a plurality of memory cells, which in particular smaller programming voltages required, and a high-density memory cell array allows.
Aufgabe der Erfindung ist es demgemäß, einen Halbleiterspeicher mit einer Vielzahl von Speicherzellen anzugeben, welcher insbesondere kleinere Programmierspannungen benötigt und ein hochdichtes Speicherzellenfeld gestattet.
At power-up of the device all the circuit components can first initialize and all internal voltages are stabilized before access is granted to the memory cell array.
Bei Hochfahren des Bauelements können zunächst alle Schaltungskomponenten initialisiert sowie alle internen Spannungen stabilisiert werden, bevor der Zugriff auf das Speicherzellenarray freigegeben wird.
The semiconductor memory device as set forth in claim 1, in which said memory cell array (31) is formed by a plurality of dynamic random access memory cells.
Halbleiterspeichervorrichtung nach Anspruch 1, wobei das Speicherzellenarray (31) durch eine Vielzahl von dynamischen Direktzugriffsspeicherzellen gebildet ist.
This object is achieved with a memory cell array of the type mentioned in that at least one trench to at least one side wall in the semiconductor substrate is present, the first address line runs along the trench on the side wall.
Diese Aufgabe wird erfindungsgemäß mit einer Speicherzellenanordnung der eingangs genannten Art dadurch gelöst, daß zumindest ein Graben mit zumindest einer Seitenwand im Halbleitersubstrat vorhanden ist, wobei die erste Adreßleitung längs des Grabens an dessen Seitenwand verläuft.
A nonvolatile memory device according to claim 1, further comprising a memory cell array wherein a plurality of the memory cells are arranged in a matrix.
Nichtflüchtige Speichervorrichtung nach Anspruch 1, die ferner eine Speicherzellenanordnung aufweist, in der mehrere Speicherzellen in einer Matrix angeordnet sind.
Firstly, it is advantageous if data signals are involved various word lines of the memory cell array in the parity check.
Zum einen ist vorteilhaft, wenn Datensignale von verschiedenen Wortleitungen des Speicherzellenfeldes in die Paritätsüberprüfung miteinbezogen werden.
The first lines are thus those lines which connect in a memory cell array rows of memory cells.
Die ersten Leitungen sind somit solche Leitungen, die in einem Speicherzellenfeld Zeilen von Speicherzellen anschließen.
The invention relates to a memory circuit having a memory cell array having arranged on word lines and bit dynamic memory cells which must be refreshed to maintain the stored information.
Die Erfindung betrifft eine Speicherschaltung mit einem Speicherzellenfeld, das an Wortleitungen und Bitleitungen angeordnete dynamische Speicherzellen aufweist, die zum Aufrechterhalten der gespeicherten Information aufgefrischt werden müssen.
For the control of the individual memory cells of the first address lines are led out from the memory cell array out to the periphery of the semiconductor substrate.
Zum Ansteuern der einzelnen Speicherzellen werden die ersten Adreßleitungen aus dem Speicherzellenfeld heraus bis zur Peripherie des Halbleitersubstrats geführt.
The transistor array device of claim 15 wherein said transistors of said array are part of a memory cell array.
Transistorarraybauelement nach Anspruch 15, wobei die Transistoren des Arrays Teil eines Speicherzellenarrays sind.
A semiconductor memory device according to claim 6, wherein a plurality of memory cells belong to a memory cell array having first and second subarrays.
Halbleiterspeichervorrichtung nach Anspruch 6, wobei eine Vielzahl von Speicherzellen zu einem Speicherzellenfeld gehört, das ein erstes und ein zweites Unterfeld hat.
A semiconductor integrated circuit as claimed in claim 1, further comprising a memory cell array (101) having a plurality of memory cells coupled to said data buses.
Integrierte Halbleiterschaltung nach Anspruch 1, weiterhin enthaltend eine Speicherzellenanordnung (101) mit einer Anzahl von mit den Datenbussen gekoppelten Speicherzellen.
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