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Address decoder
Adressendekoder mit geringer Schaltungsgrösse und Adressbereicherweiterungsmöglichkeit.
Address decoder with small circuit scale and address area expansion capability.
Adressendekoder mit Speicherzuordnung für ein Mikrokontrollersystem.
Address decoder with memory allocation for a micro-controller system.
Vorrichtung nach Anspruch 3, worin der Adressendekoder (220) eine Adresse von einer Stelle der Speichereinrichtung (142) dekodiert, wenn der Mikroprozessor (202) einen Zugriff auf die Stelle versucht, um festzustellen, ob die Stelle eine gültige Stelle ist.
The device of Claim 3, wherein the address decoder (220) decodes an address of a location of the memory device (142) when the microprocessor (202) attempts to access the location in order to determine if the location is a valid location.
Andere resultaten
Halbleiterspeichervorrichtung mit einem an Adressendekodierer angeschlossenen Schalter zur Deaktivierung einer defekten Speicherzelle.
NICHTFLÜCHTIGER SPEICHER UND BESCHLEUNIGTES TESTVERFAHREN FÜR ZUGEHÖRIGEN ADRESSENDEKODIERER DURCH ZUGEFÜGTE MODIFIZIERTE DUMMY-SPEICHERZELLEN
NON-VOLATILE MEMORY AND ACCELERATED TEST METHOD FOR ADDRESS DECODER BY ADDED MODIFIED DUMMY MEMORY CELLS
Tastatur nach Anspruch 1, zur Ansteuerung eines netzwerkfähigen PC, dadurch gekennzeichnet, daß deren Empfänger (3) über einen die empfangenen Daten entsprechend der dekodierten Adresse einer dieser Adresse zugeordneten Schnittstellenkarte zuleitenden Adressendekodierer verfügt.
A keyboard according to claim 1, for selecting a networkable PC, characterised in that its receiver (3) comprises an address decoder which directs the received data to an interface card allocated to this address, in accordance with the decoded address.
Einrichtung nach Anspruch 4, dadurch gekennzeichnet , daß sie mit einem Adressendecodierer versehen ist, dessen Eingang mit dem Adressenbus des Systems verbunden ist und der das Schieberegister in Betrieb setzt, wenn bestimmte Adressen auf dem Adressenbus angeboten werden.
A device as claimed in Claim 4, characterized in that it is provided with an address decoder whose input is connected to the address bus of the system and which puts the shift register into operation when specified addresses are presented on the address bus.
Kombination nach Anspruch 1, bei der die Datenübertragungs- und Antworteinheit jedes der mehreren Slavesysteme einen Adressendecodierer (53) aufweist, um zu ermitteln, ob die Daten vom Systembus an dieses jeweilige Slavesystem adressiert sind.
The combination of claim 1, wherein said data transferring and replying unit of each of said plurality of slave systems includes an address decoder (53) for determining whether the data from said system bus is addressed to the respective slave system.
Halbleiterspeicher nach Anspruch 2, bei dem der Adressendecodierer (9, 12, 61) als Vordecodierer des Reihendecodierers dient.
A semiconductor memory according to claim 2, in which the address decoder (9,12,61) serves as a predecoder of the row decoder.
Speichers 131 ist an einen Adressendecodierer 156 angeschlossen, der mit einem Steuerbus und dem Adressenbus der Zentraleinheit verbunden ist.
connected to an address decoder 156 which is connected to a control bus and the address bus of the central unit. angeschlossen.
Multiplexeinrichtung nach Anspruch 1, in welcher die Speichereinrichtung ein FIFO (First-In First-Out)-Speicher und die Steuereinrichtung ein FIFO-Adressendecodierer (118; 150) ist.
A multiplexing apparatus according to claim 1 in which said memory means is a FIFO (First-In First-Out) memory and said control means is a FIFO address decoder (118; 150).
Steuersystem nach einem der vorangehenden Ansprüche, wobei der Adressendecodierer (20) weiterhin eine Einrichtung zum Aufteilen der Speichereinheiten in gültige adressierbare Bereiche in Antwort auf die Daten in einzelnen der Register (8) enthält.
A control system as claimed in any preceding claim wherein said address decoder (20) further includes means for partitioning said memory units into valid addressable regions in response to said data in ones of said registers (8).
Computersystem nach Anspruch 1, mit einem mit der Steuerschaltung verbundenen Adressendecodierer (116), wobei der Adressendecodierer während des I/O-Zugriffszyklus deaktiviert ist.
The computer system as recited in Claim 1 including an address decoder (116) coupled to said control circuit, wherein said address decoder is disabled during said I/O access cycle.
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