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The array processor
Arrayprozessor nach Anspruch 19, wobei der Cluster-Schalter dazu angeschlossen ist, Kommunikation zwischen innerhalb eines Clusters umgestellten Verarbeitungselementen zu multiplex-übertragen.
The array processor of claim 19, wherein said cluster switch is connected to multiplex communications between transpose processing elements within a cluster.
Arrayprozessor nach Anspruch 18, wobei der Cluster-Schalter dazu angeschlossen ist, Kommunikation von den Verarbeitungselementen innerhalb eines Clusters zur Übertragung an einen anderen Cluster zu multiplex-übertragen.
The array processor of claim 18, wherein said cluster switch is connected to multiplex communications from the processing elements within a cluster for transmission to another cluster.
Arrayprozessor nach Anspruch 14, wobei ein Cluster-Schalter die Multiplexeinheiten aufweist und der Cluster-Schalter dazu angeschlossen ist, von zwei sich wechselseitig ausschließenden Torusrichtungen empfangene Kommunikation zu Verarbeitungselementen innerhalb eines Clusters zu multiplex-übertragen.
The array processor of claim 14, wherein a cluster switch comprises said multiplexers and said cluster switch is connected to multiplex communications received from two mutually exclusive torus directions to processing elements within a cluster.
Arrayprozessor nach Anspruch 14, wobei wenigstens ein Cluster ein NxN-Torusumgestelltes Paar aufweist.
The array processor of claim 14, wherein at least one cluster includes an N x N torus transpose pair.
Arrayprozessor nach Anspruch 14, wobei die Verarbeitungselemente jedes Clusters in der nördlichen und östlichen Torusrichtung mit einem Cluster und in der südlichen und westlichen Torusrichtung mit einem anderen Cluster kommunizieren.
The array processor of claim 14, wherein the processing elements of each cluster communicate to the North and East torus directions with one cluster and to the South and West torus directions with another cluster.
Arrayprozessor nach Anspruch 1, dadurch gekennzeichnet, daß der Takt (cl) auf dem Chip topologisch als H-Baum (h) an die einzelnen Zellen (zp) geführt ist.
An array processor as claimed in claim 1, characterized in that on the chip, the clock signal (cl) is routed to the individual cells (zp) topologically as a H tree (h).
VERFAHREN UND VORRICHTUNG UM BEDINGTE AUSFÜHRUNG IN EINEM VLW BASIERTEN ARRAYPROZESSOR MIT UNTERWÖRTAUSFÜHRUNG ZU UNTERSTÜTZEN
METHODS AND APPARATUS TO SUPPORT CONDITIONAL EXECUTION IN A VLIW-BASED ARRAY PROCESSOR WITH SUBWORD EXECUTION
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