Examples with "der Adressendecoder" and their translation in Engels
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Schaltungsanordnung nach Anspruch 5, dadurch gekennzeichnet , daß an die Adressendecoder (ADC1, ADC2) ein Antivalenzglied (EXO) angeschlossen ist, das, wenn die Ausgangssignale der Adressendecoder antivalent sind, ein Fehlersignal abgibt.
Circuit arrangement according to claim 5, characterised in that, to the address decoders (ADC1, ADC2), there is connected an exclusive-OR element (EXO) which, when the output signals of the address decoders are not the same, emits a fault signal.
Andere resultaten
System nach Anspruch 6, wobei der Speicher einen Adressendecoder aufweist und wobei das Umwandlungsmittel mit dem Adressendecoder funktionell vermischt ist zum selektiven Aktivieren eines einzelnen Ausgangs einer Anzahl Decoderausgänge.
The system of Claim 6, wherein the memory includes an address decoder, and wherein the converging means is functionally merged with the address decoder to selectively activate a single one of a plurality of decoder outputs.
Eingabetastenanordnung nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, daß jeder Taste ein Adressendecoder zugeordnet ist, der durch die Verwaltungsschaltung (13,14,15) adressierbar ist.
Input key arrangement according to one of the preceding claims, characterized in that each key has an associated address decoder which can be addressed by the management circuit (13, 14, 15).
Verfahren nach irgendeinem der Ansprüche 7 bis 9, bei welchem die Schritte des Deaktivierens bzw. Sperrens Adressendecoder deaktivieren bzw. sperren, die in den Zugriffsschritten verwendet werden.
The method of any one of claims 7 to 9 wherein said disabling steps disable address decoders used in said accessing steps.
Halbleiterspeicher gemäß Anspruch 3, dadurch gekennzeichnet, daß er des weiteren einen Adressendecoder (AD) zum Empfang der Ausgänge der n Schreibdaten-Zwischenspeicherschaltungen (WL1, WL2, ..., WLn) umfaßt.
A semiconductor memory according to claim 3, characterized by further comprising an address decoder (AD) for receiving outputs from said n write data latch circuits (WL1, WL2, ..., WLn).
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