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erzeugte HDL-Code
Examples with "erzeugte HDL-Code" and their translation in Engels
Der erzeugte HDL-Code ist synthetisierbar und kann einfach für Synthese- und Layout-Werkzeuge für die Hardware-Realisierung exportiert werden.
The generated HDL code is synthesizable, and can be easily exported to synthesis and layout tools for hardware realization.
Andere resultaten
Sie können mit der Hand erzeugten HDL-Code integrieren und ihn mit Ihrem HDL-Simulator parallel simulieren.
You can integrate hand-written HDL code and cosimulate it with your HDL simulator.
Neben synthetisierbarem VHDL- und Verilog-Code erzeugt HDL Coder auch IP-Kerne, die sich zur Systemintegration sehr einfach in Vivado IP Integrator einfügen.
Along with synthesizable VHDL and Verilog, HDL Coder generates IP cores that easily plug into Quartus Prime for system integration.
Durch Parallelsimulation mit Drittanbieter-HDL-Simulationen können Sie die Verifikation der Hardware automatisieren, unabhängig davon, ob von Hand erstellter oder automatisch erzeugter HDL-Code betroffen ist - Sie verifizieren Ihre HDL-Entwicklungen gegen die ursprünglichen Algorithmus-Spezifikationen indem Sie Ihre Modelle als Teststände wiederverwenden.
Through cosimulation with third-party HDL simulators you can automate the verification of handwritten or automatically generated HDL code - you quickly verify your HDL designs against the original algorithm specification by reusing your models as test benches.
HDL Coder ermöglicht die Rückverfolgbarkeit zwischen Ihrem Simulink-Modell und dem erzeugten Verilog- bzw. VHDL-Code und damit auch die Codeverifizierung bei Hochintegritätssystemen gemäß DO-254 und anderen Standards.
HDL Coder provides traceability between your Simulink model and the generated Verilog and VHDL code, enabling code verification for high-integrity applications adhering to DO-254 and other standards.
Die Distributed Arithmetik-Option des Filter Design HDL Coder, bei der die Filterrate 16 bis 20-mal so hoch ist wie die Datenrate, erzeugte im Vergleich einen Entwurf, der nur etwa ein Viertel der Fläche des vollständig parallelen Entwurfs benötigte.
The distributed arithmetic option in Filter Design HDL Coder, which required a clock rate 16 to 20 times higher than its data rate, produced a design that used about 25% of the area of the fully parallel design.
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Synoniemen voor erzeugte HDL-Code in het Duits
Resultaten: 6. Exact: 1. Verstreken tijd: 57 ms.
