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If this is the case, a hit signal (SU) is emitted, which can be used to interrupt the further processing until the modified instruction is contained in the instruction cache arrangement or in the pipeline.
Ist dies der Fall, dann wird ein Treffersignal (SU) abgegeben, das dazu verwendet werden kann, die Weiterbearbeitung solange zu unterbrechen, bis der modifizierte Befehl in der Befehlscacheanordnung bzw. in der Pipeline enthalten ist.
In order to prevent this, it is checked in an arrangement (SN) whether the write addresses (VD-ADR) under which the processing results are stored during instruction execution are the addresses of instructions in the instruction cache arrangement or in the pipeline.
Um dies zu verhindern, wird in einer Anordnung (SN) überprüft, ob die Schreibadressen (VD-ADR), unter der die Bearbeitungsergebnisse bei der Befehlsausführung abgespeichert werden, die Adressen von Befehlen in der Befehlscacheanordnung bzw. in der Pipeline sind.
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