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CAM-Array
The CAM array of claim 1, wherein the precharge voltage level is ground.
CAM-Array nach Anspruch 1, bei dem der Vorladungsspannungspegel Erde ist.
The CAM array of claim 2, wherein the timing circuits include reference matchlines.
CAM-Array nach Anspruch 2, bei dem die Zeitgeberschaltungen Referenz-Paßgenauigkeitsleitungen enthalten.
The CAM array of claim 1, wherein the output of each matchline sense amplifier is stored in a latch circuit.
CAM-Array nach Anspruch 1, bei dem die Ausgabe eines jeden Paßgenauigkeitsleitungsleseverstärkers in einer Verriegelungsschaltung gespeichert wird.
The CAM array of claim 1, wherein timing circuits control precharge and sensing operations of the matchline sense amplifiers.
CAM-Array nach Anspruch 1, bei dem Zeitgeberschaltungen das Vorladen und Leseoperationen der Paßgenauigkeitsleitungsleseverstärker steuern.
The CAM array of claim 7, wherein the first matchline segment is coupled to fewer content addressable memory cells than the second matchline segment.
CAM-Array nach Anspruch 7, bei dem das erste Paßgenauigkeitsleitungssegment mit weniger inhaltsadressierbaren Speicherzellen als das zweite Paßgenauigkeitsleitungssegment gekoppelt ist.
The CAM array of claim 6, wherein the matchline sense amplifier associated with the first matchline segment enables the matchline sense amplifier associated with the second matchline segment.
CAM-Array nach Anspruch 6, bei dem der Paßgenauigkeitsleitungsleseverstärker, der dem ersten Paßgenauigkeitsleitungssegment zugeordnet ist, den Paßgenauigkeitslesaverstärker freigibt, der dem zweiten Paßgenauigkeitsleitungssegment zugeordnet ist.
The CAM array of claim 1 embodied in a data compression chip, wherein the circuit means (74) comprises a data compressor (14).
CAM-Matrix nach Anspruch 1, die in einem Datenkompressionschip realisiert ist, wobei die Schaltungseinrichtung (74) einen Datenkompressor (14) umfaßt.
A cache memory according to claim 6 in which said masking circuitry comprises gate circuitry (512) in each partition connected between the CAM array (510) and the data RAM (518) of each partition.
Cachespeicher nach Anspruch 6, bei dem die Maskierungsschaltkreisanordnung eine Gateschaltkreisanordnung (512) in jeder Partition umfasst, die zwischen der CAM-Andord-nung (510) und dem Daten-RAM (518) jeder Partition angeschlossen ist.
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