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Logische Anordnung
Logikanordnung
A logic array according to Claim 1, characterized in that said delay means includes means (QDG) for discharging said common conductor line prior to the operation of said one or more OR sets.
Logische Anordnung nach Anspruch 1, dadurch gekennzeichnet , daß die Verzögerungsmittel Mittel (QDG) enthalten zum Entladen des gemeinsamen Leiters vor dem Betrieb der einen oder mehreren ODER-Gruppen.
A logic array according to Claim 1, characterized in that the common conductors are precharged via FETs (QPG) in the OR sets during precharge of the row-conductors.
Logische Anordnung nach Anspruch 1, dadurch gekennzeichnet , daß beim Voraufladen der Zeilenleiter die gemeinsamen Leiter über Feldeffekttransistoren (QPG) in den ODER-Gruppen voraufgeladen werden.
A logic array according to Claim 5, characterized in that during each operation all selected AND sets and all selected OR sets have their gates precharged whereby no quiescent or d.c. power is dissipated in the array during operation.
Logische Anordnung nach Anspruch 5, dadurch gekennzeichnet , daß in jedem Betrieb die Gates sämtlicher ausgewählter UND-Gruppen und die Gates sämtlicher ausgewählter ODER-Gruppen voraufgeladen sind, wobei im Betrieb in der Anordnung keine Ruheleistung oder Gleichstromleistung verbraucht wird.
In computer design, a logic array manages multiple gates to improve performance.
Im Computerdesign verwaltet ein Logikarray mehrere Gatter, um die Leistung zu verbessern.
A system for configuring a logic array chip as in claim 8 in which said second means comprises a microprocessor.
System zum Konfigurieren eines Logikarray-Chips nach Anspruch 8, bei dem die zweite Einrichtung einen Mikroprozessor aufweist.
A programmable logic circuit according to any of claims 1 to 5, which includes buffer circuitry (30,31) connected to inputs and/or outputs of the circuit to enable it to cooperate with neighbouring circuits to form a logic array.
Programmierbare Logik-Schaltung nach einem der Ansprüche 1 bis 5, die eine Puffer-Schaltungsanordnung (30, 31) umfaßt, welche mit Eingängen und/oder Ausgängen der Schaltung verbunden ist, um sie freizugeben, mit benachbarten Schaltungen zur Bildung eines Logikfeldes zusammenzuarbeiten.
A system for configuring a logic array chip as in claim 5 further including means for loading said configuration information as a serial bit stream (D₀₋₇, 112, AD₀₋₁₅).
System zum Konfigurieren eines Logikarray-Chips nach Anspruch 5, das weiterhin eine Einrichtung zum Laden der Konfigurations-Information als ein serieller Bitstrom (D₀₋₇, 112, AD₀₋₁₅) umfaßt.
A power switching circuit as claimed in Claim 7, including a logic array controlling said first and second semiconductor switch elements (31, 32) and incorporating said digital counting means.
Energie-Schaltschaltung nach Anspruch 7, mit einem Logikfeld, dass die ersten und zweiten Halbleiter-Schaltelemente (31, 32) steuert und die digitale Zähleinrichtung beinhaltet.
A system for configuring a logic array chip as in claim 10 in which said means for storing said configuration information comprises a nonvolatile memory (EPROM).
System zum Konfigurieren eines Logikarray-Chips nach Anspruch 10, bei dem die Einrichtung zum Speichern der Konfigurations-Information einen nichtflüchtigen Speicher (EPROM) aufweist.
A system for configuring a logic array chip as in claim 15 further comprising said second configurable logic array chip (Slave 1) connected so as to receive said configuration information from said first configurable logic array chip (Master).
System zum Konfigurieren eines Logikarray-Chips nach Anspruch 15, das weiterhin den zweiten konfigurierbaren Logikarray-Chip (Slave 1) aufweist, der zum Empfang der Konfigurations-Information aus dem ersten konfigurierbaren Logikarray-Chip (Master) verbunden ist.
A system incorporating a programmable logic device (121) with a logic array block as recited in any of Claims 1 to 8.
System, das eine programmierbare Logikvorrichtung (121) mit einem Logikgatteranordnungsblock nach irgendeinem der Ansprüche 1 bis 8 enthält.
Each FLEX 10K device contains an embedded array and a logic array.
Jedes Gerät des FLEX 10K enthält eine eingebettete Reihe und eine Logikreihe.
A logic array as in claim 4 further characterized by comprising a verification fuse (28-11) connected in series with said verification transistor second current handling terminal and said verify output terminal.
Logikanordnung nach Anspruch 4, dadurch gekennzeichnet, daß sie des weiteren eine Verifiziersicherung (28-11) umfaßt, die mit der zweiten Strombehandlungsklemme des Verifiziertransistors und der Verifizierausgangsklemme in Reihe geschaltet ist.
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