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array logic according
Vertaling van "array logic according" in Duits
Feldlogik nach
Array logic according to claim 2 or 3, characterised in that the second register means (26) functions as a comparator in the first mode and to load outputs during specified time intervals in the second mode.
Feldlogik nach Anspruch 2 oder 3, dadurch gekennzeichnet, daß die zweite Registereinrichtung (26) im ersten Modus als Vergleicher arbeitet und im zweiten Modus während vorgegebener Zeitintervalle Ausgangssignale lädt.
Array logic according to claim 5, characterised in that it additionally comprises bus means for coupling control signals between the RAM programmable logic array (12), the first register means (16) and the second register means (26).
Feldlogik nach Anspruch 5, dadurch gekennzeichnet, daß sie zusätzlich eine Bus-Vorrichtung zum Verteilen der Steuersignale zwischen der RAM programmierbaren Feldlogik (12), der ersten Registereinrichtung (16) und der zweiten Registereinrichtung (26) aufweist.
Array logic according to any of the preceding claims, characterised in that the RAM programmable logic array (12) is coupled to tri-state latches (28) and transceivers (30).
Feldlogik nach einem der vorangehenden Ansprüche, dadurch gekennzeichnet, daß die RAM programmierbare Feldlogik (12) an Verriegelungsschaltungen (28) mit drei Schaltzuständen sowie an Sender/Empfänger (30) angeschlossen ist.
Array logic according to claim 9, characterised in that the RAM programmable logic array (12) is coupled to a PROM (32) and a RAM (34) via a local data bus (38) and local address bus (36).
Feldlogik nach Anspruch 9, dadurch gekennzeichnet, daß die RAM programmbare Feldlogik über einen lokalen Datenbus (38) und einen lokalen Adressenbus (36) an einen programmierbaren Lesespeicher PROM (32) und einen Schreib/Lesespeicher (RAM) mit wahlfreiem Zugriff (34) angeschlossen ist.
Andere resultaten
A programmable integrated circuit logic array device according to any preceding claim, wherein the reprogrammable memory device is an EEPROM transistor.
Programmierbare integrierte Schaltlogikbereichseinheit nach einem der vorangehenden Ansprüche, wobei die reprogrammierbare Speichereinheit ein EEPROM-Transistor ist.
A programmable logic array according to claim 1 wherein the further product line is also connected to all the data bit lines.
Programmierbare logische Anordnung nach Anspruch 1, dadurch gekennzeichnet, daß die weitere Produktleitung auch mit allen Datenbitleitungen verbunden ist.
A programmable logic array circuit according to claim 1, wherein said latch circuit (60) comprises a D-type flip flop.
Programmierbare Logikanordnung gemäß Anspruch 1, bei der die Latch-Schaltung (60) ein D-Typ Flip-Flop aufweist.
A programmable logic array according to claim 1 or 2 wherein the sequencing means comprises a linear feedback shift register (22,23).
Programmierbare logische Anordnung nach Anspruch 1 oder 2, dadurch gekennzeichnet, daß die Folgesteuerung ein lineares Rückkopplungs-Schieberegister (22, 23) aufweist.
A programmable logic array according to claim 1 wherein said first sequencing means comprises a register (18) connected to said bit lines and operable as a circular shift register.
Programmierbare logische Anordnung nach Anspruch 1, bei der die erste Folgesteuerung ein Register (18) aufweist, das mit den Bitzeilen verbunden ist und das als Kreis-Schieberegister betrieben wird.
A logic array according to Claim 1, characterized in that said delay means includes means (QDG) for discharging said common conductor line prior to the operation of said one or more OR sets.
Logische Anordnung nach Anspruch 1, dadurch gekennzeichnet , daß die Verzögerungsmittel Mittel (QDG) enthalten zum Entladen des gemeinsamen Leiters vor dem Betrieb der einen oder mehreren ODER-Gruppen.
A logic array according to claim 1 wherein said first second and third electrodes are respectively the gate, the source and the drain of said second FET (Q5).
Eine logische Anordnung nach Anspruch 1, bei der die erste, zweite und dritte Elektrode die Gateelektrode, die Sourceelektrode bzw. die Drainelektrode des zweiten FET (Q5) sind.
A logic array according to Claim 5, characterized in that during each operation all selected AND sets and all selected OR sets have their gates precharged whereby no quiescent or d.c. power is dissipated in the array during operation.
Logische Anordnung nach Anspruch 5, dadurch gekennzeichnet , daß in jedem Betrieb die Gates sämtlicher ausgewählter UND-Gruppen und die Gates sämtlicher ausgewählter ODER-Gruppen voraufgeladen sind, wobei im Betrieb in der Anordnung keine Ruheleistung oder Gleichstromleistung verbraucht wird.
A CMOS programmable logic array according to one or more of claims 1-6, characterized in that said power supply voltage is positive, said normally-off transistors are N-channel transistors and said normally-on transistors are P-channel transistors.
Programmierbares logisches Feld in CMOS-Technik nach einem oder mehreren der Ansprüche 1 bis 6, dadurch gekennzeichnet, daß die Versorgungsspannung positiv ist, die normal ausgeschalteten Transistoren N-Kanaltransistoren sind und die normal eingeschalteten Transistoren P-Kanaltransistoren sind.
Synoniemen voor array logic according in het Engels
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