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Hauptbitleitung
The semiconductor memory of any preceding claim wherein each master bitline is of about the same length (D 3) as each local bitline and is about one half of a column length between spaced sense amplifiers, and master bitlines are interleaved in alternating columns.
Halbleiterspeicher nach irgendeinem vorhergehenden Anspruch, worin jede Hauptbitleitung ungefähr die gleiche Länge (D3) hat wie jede lokale Bitleitung und sich über ungefähr die Hälfte einer Spaltenlänge zwischen benachbarten Leseverstärkern erstreckt, und die Hauptbitleitungen in abwechselnden Spalten verschachtelt sind.
The semiconductor memory of claim 17 wherein sense amplifiers are arranged in a shared configuration, with a first master bitline (MBL 1) operatively coupled to said first side and a second master bitline (MBL 2) operatively coupled to a second side thereof.
Halbleiterspeicher nach Anspruch 17, worin die Leseverstärker in gemeinsamer Anordnung untergebracht sind, und eine erste Hauptbitleitung (MBL 1) funktionell mit der ersten Seite und eine zweite Hauptbitleitung (MBL 2) funktionell mit der zweiten Seite des Leseverstärkers verbunden ist.
The semiconductor memory of claims 1 or 2 wherein width (W M) of each master bitline is about one half of the pitch (D 2) of the master bitlines.
Halbleiterspeicher nach Anspruch 1 oder 2, worin die Breite (W M) jeder Hauptbitleitung ungefähr halb so groß ist wie der Abstand (D2) der Hauptbitleitungen.
The semiconductor memory of claim 8 wherein said true master bitline (MBL) is connected to said second true local bitline (LBL 2) and said complementary master bitline (MBL) is connected to said second complementary local bitline (LBL 2).
Halbleiterspeicher nach Anspruch 8, worin die True-Hauptbitleitung (MBL) mit der zweiten lokalen True-Bitleitung (LBL 2) verbunden ist, und die Komplementär-Hauptbitleitung (MBL) mit der zweiten lokalen Komplementär-Bitleitung (LBL 2) verbunden ist.
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