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A method as claimed in claim 7, wherein the invalidation constant is a sequence of predecode bits that is unlikely to be generated during said generating.
Verfahren nach Anspruch 7, bei dem die Invalidations-Konstante eine Sequenz von Vordekodier-Bits ist, für die kaum Wahrscheinlichkeit besteht, dass die während des Erzeugungsvorgangs erzeugt wird.
The method of claim 5, further comprising: storing an indicator bit for each logical block in the level two cache, wherein the indicator bit is indicative of whether predecode bits or error checking and correction bits are stored therein.
Verfahren nach Anspruch 5, das ferner umfasst: Speichern eines Indikatorbits für jeden Logikblock in dem Cache-Speicher der Ebene 2, wobei das Indikatorbit angibt, ob Vordecodierungsbits oder Fehlerprüf- und Korrekturbits darin gespeichert sind.
A microprocessor as claimed in claim 1, 2 or 3, wherein the predetermined invalidation constant is a sequence of predecode bits that is unlikely to be generated by the predecode unit (12) during instruction predecoding operations.
Microprozessor nach Anspruch 1, 2 oder 3, bei dem die vorbestimmte Invalidations-Konstante eine Sequenz von Vordekodier-Bits ist, für die kaum Wahrscheinlichkeit besteht, dass sie während Instruktionsvordekodier-Operationen von der Vordekodiereinheit (12) erzeugt wird.
A microprocessor as claimed in claim 4, wherein the instruction cache (16) is configured to store predecode information for the instruction bytes, wherein the predecode information includes predecode bits indicative of instruction starting bytes.
Mikroprozessor nach Anspruch 4, bei dem der Instruktions-Cache-Speicher (16) zum Speichern von Vordekodier-Information für die Instruktions-Bytes konfiguriert ist, wobei die Vordekodier-Information Vordekodier-Bits enthält, die Instruktions-Start-Bytes angeben.
USING TYPE BITS TO TRACK STORAGE OF ECC AND PREDECODE BITS IN A LEVEL TWO CACHE
VERWENDUNG VON TYPENBIT ZUR VERFOLGUNG DER SPEICHERUNG VON ECC- UND VORDEKODIERUNGSBIT IN EINEM CACHE DER EBENE 2
A method as claimed in claim 15, further comprising storing a plurality of predecode bits into the instruction cache (16), wherein the predecode bits indicate the presence of branch instructions and the presence of offset bytes stored as immediate data in direct branch instructions.
Verfahren nach Anspruch 15, ferner mit dem Schritt des Speicherns mehrerer Vordekodier-Bits in dem Instruktions-Cache-Speicher (16), wobei die Vordekodier-Bits das Vorhandensein von Abzweig-Instruktionen und das Vorhandensein von Offset-Bytes angeben, die als unmittelbare Daten in den Direkt-Abzweig-Instruktionen gespeichert sind.
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