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said cache controller
Vertaling van "said cache controller" in Duits
der Cache-Controller
das Cache-Steuergerät
A cache controller according to any preceding claim, wherein said cache controller is a second level cache controller for a two level cache system.
Cache-Controller nach einem vorangegangenen Anspruch, bei dem der Cache-Controller ein Cache-Controller auf der zweiten Ebenen für ein Cache-System mit zwei Ebenen ist.
A computer system (100) as claimed in claim 9, wherein said cache controller (106,202) includes direction logic responsive to the request type for determining whether the prefetching from the main memory (107) is in ascending or descending order.
Ein Computersystem (100) nach Anspruch 9, wobei der Cache-Controller (106,202) eine Richtungslogik enthält, die auf den Anforderungstyp reagiert, um festzustellen, ob das Vorausladen aus dem Hauptspeicher (107) in aufsteigender oder absteigender Reihenfolge erfolgen soll.
A computer system (100) as claimed in claim 3, wherein said cache controller (106,202) is responsive to the first CPU control signal indicating an instruction request for prefetching the number of instruction bytes stored in the programmable prefetch control register (207).
Ein Computersystem (100) nach Anspruch 3, wobei der Cache-Controller (106,202) auf das erste CPU-Steuersignal, das eine Instruktionsanforderung zum Vorausladen der im programmierbaren Vorausladesteuerregister (207) gespeicherten Anzahl von Instruktionsbytes angibt, reagiert.
The method according to claim 10, wherein if said new cache access operation results in a block miss, then said cache controller (6) instructs said CPU (2) to retry said cache access operation.
Das Verfahren nach Anspruch 10, wobei dann, wenn die neue Cache-Zugriffsoperation zu einem Block-Fehlversuch führt, der Cache-Controller (6) die CPU (2) anweist, die Cache-Zugriffsoperation erneut zu versuchen.
The method according to claim 10, wherein said new cache access operation is accepted by said cache controller (6) for a second target sub-block while previously issued cache operation is pending for a first target sub-block.
Das Verfahren nach Anspruch 10, wobei die neue Cache-Zugriffsoperation von dem Cache-Controller (6) für einen zweiten Ziel-Unterblock akzeptiert wird, während die zuvor ausgegebene Cache-Operation für einen ersten Ziel-Unterblock anhängig ist.
The bus-master of claim 4 wherein said cache controller (116) maintains said shared status information in said status storage (144) in response to said input signal logic state.
Bus-Master nach Anspruch 4, bei dem die Cache-Speicher-Steuervorrichtung (116) die gemeinsamen Statusinformationen in Reaktion auf den logischen Zustand des Eingangssignals in dem Statusspeicher (144) halten.
The computer system of claim 3, wherein said storage means (400) is at least partially enabled by a signal (BACP) from said cache controller (24) used for controlling said means for coupling said first and second buses.
Das Computersystem des Anspruchs 3, wobei die genannte Speichereinrichtung (400) wenigstens teilweise durch ein Signal (BACP) von der genannten Cache-Steuerschaltung (24) freigegeben wird, das zur Steuerung der genannten Einrichtung zum Koppeln des genannten ersten und zweiten Buses verwendet wird.
The I/O channel controller (114) as recited in claim 3, further comprising: means for implementing page level snooping of said I/O read data cache directory coupled to said cache controller (203).
E/A-Kanalsteuereinheit (114) nach Anspruch 3, die weiterhin umfasst: Mittel zum Implementieren einer auf Seitenebene stattfindenden Durchsuchung des mit dem Cache-Controller (203) verbundenen Verzeichnisses des E/A-Lesedaten-Cache.
A method as in claim 9 wherein the step of revalidating said dirty addressable data entry in said cache memory (16) occurs after said cache controller (14) receives said first status signal from said bus interface controller (20).
Ein Verfahren nach Anspruch 9, wobei der Schritt, den veränderten adressierbaren Dateneintrag im Cachespeicher weider gültig zu machen, auftritt, nachdem das Cache-Steuergerät (14) das erste Statussignal von der Busschnittstellensteuerung (20) empfängt.
A method as in claim 8 wherein the step of simultaneously transferring said read transfer request, and said read address to said bus interface controller (20) occurs after said cache controller (14) detects a miss in said cache memory (16).
Ein Verfahren nach Anspruch 8, wobei der Schritt die Anforderung für die Leitungsübertragung (Lesen) und die Leseadresse gleichzeitig an die Busschnittstellensteuerung (20) zu übertragen, auftritt, nachdem das Cache-Steuergerät (14) einen Fehler im Cachespeicher (16) erkennt.
Synoniemen voor said cache controller in het Engels
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