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zweite Befehlssatz
Method according to at least any one of claims 9 to 13, characterized in that said second instruction set does not allow operations in parallel.
Verfahren nach mindestens einem der Ansprüche 9 bis 13, dadurch gekennzeichnet, dass der genannte zweite Befehlssatz keine Paralleloperationen erlaubt.
The computer program product as recited in claim 15, wherein said second instruction set further comprises instructions for comparing the compression efficiencies of subsets of said dictionaries with respect to previously encoded phrases.
Das Computerprogrammprodukt gemäß Anspruch 15, wobei der genannte zweite Befehlssatz weiterhin Befehle für den Vergleich der Kompressionsleistungen der Nebengruppen der genannten Wörterbücher mit zuvor kodierten Phrasen umfasst.
Apparatus as claimed in claim 1, wherein said second instruction set provides a subset of operations provided by said first instruction set.
Vorrichtung nach Anspruch 1, wobei der zweite Befehlssatz einen Teilsatz von Vorgängen bereitstellt, die durch den ersten Befehlssatz bereitgestellt werden.
A computer program product as claimed in any one of claims 41 to 56, wherein said second instruction set is a native instruction set of a processor core executing said program instructions.
Computerprogrammprodukt nach einem der Ansprüche 41 bis 56, wobei der zweite Befehlssatz ein natürlicher bzw. zugehöriger Befehlssatz eines Prozessorkems ist, der die Programmanweisungen ausführt.
A computer program product as claimed in any one of the preceding claims, wherein at least one instruction word within said second instruction set has a reduced operand range compared to a corresponding program instruction word within said first instruction set.
Computerprogrammprodukt nach einem der vorstehenden Ansprüche, wobei zumindest ein Befehlswort innerhalb des zweiten Befehlssatzes einen reduzierten Operandenbereich im Vergleich zu einem entsprechenden Programmbefehlswort innerhalb des ersten Befehlssatzes hat.
The microprocessor as claimed in claim 7, wherein said pattern recognition circuit is configured to enable decoder circuits which receive instructions subsequent to said second instructions from said second instruction set.
Mikroprozessor nach Anspruch 7, bei dem die Mustererkennungsschaltung zum Aktivieren von Dekodierschaltungen konfiguriert ist, die Instruktionen anschließend an die zweiten Instruktionen aus dem zweiten Instruktions-Set empfangen.
The microprocessor of claim 2, wherein said at least one instruction coded in said second instruction set identifies a routine to be executed by said second execution core, and identifies parameters for said routine.
Mikroprozessor gemäß Anspruch 2, bei dem mindestens eine im zweiten Instruktionssatz kodierte Instruktion eine vom Ausführungskern auszuführende Routine und Parameter für diese Routine identifiziert.
A method as claimed in claim 8 or claim 9, further comprising executing said application program (82) upon said first processor (48; 152) responsive to detecting that said application program is coded to said second instruction set architecture.
Verfahren nach Anspruch 8 oder 9, ferner mit dem Schritt des Ausführens des Anwendungsprogramms (82) auf dem ersten Prozessor (48; 152), der auf das Detektieren anspricht, dass das Anwendungsprogramm auf die zweite Befehlssatzarchitektur kodiert ist.
The method as claimed in Claim 1, further comprising the step of: ordering the translated instructions of a corresponding flow of control of the second instruction set (130) to minimize branching.
Das Verfahren wie in Anspruch 1 angemeldet, das außerdem den Schritt enthält, die übersetzten Befehle aus einem entsprechenden Steuerfluß von dem zweiten Befehlssatz (130) zu ordnen, um die Verzweigung zu minimieren.
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