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A system according to claim 1, in which the array support means further comprise an m-bit wide edge register (ME) connected to the processor array (1) via the m-bit wide date path.
System gemäß Anspruch 1, worin das Speicherunterstützungsmittel weiterhin ein m-Bit breites Eckregister umfaßt, das über den m-Bit breiten Datenkanal mit dem Prozessorspeicher verbunden ist.
A SIMD processor architecture as claimed in claim 13, wherein the power management means is adapted to compute the average length of time that the processor array is idle during each processing cycle from the synchronisation signals.
SIMD-Prozessorarchitektur nach Anspruch 13, wobei das Energiemanagement-Mittel dafür eingerichtet ist, anhand der Synchronisierungssignale die mittlere Dauer zu berechnen, während der sich das Prozessorarray während jedes Verarbeitungszyklus im Leerlauf befindet.
A SIMD processor architecture as claimed in claim 1, wherein the voltage required by the processor array and control processor is dependent on the frequency of their respective local clock signals.
SIMD-Prozessorarchitektur nach Anspruch 1, wobei die durch das Prozessorarray und den Steuerungsprozessor benötigte Spannung von der Frequenz der jeweiligen lokalen Taktsignale abhängt.
A SIMD processor architecture as claimed in claim 12, wherein the frequencies of the clock signals are adjusted to reduce the time that the processor array is idle.
SIMD-Prozessorarchitektur nach Anspruch 12, wobei die Frequenzen der Taktsignale angepasst werden, um die Zeit, während der sich das Prozessorarray im Leerlauf befindet, zu reduzieren.
A radio communication system according to Claim 7, in which the multiplicity of outputs (4) of the processor array (1) are coupled to a conventional single-antenna receiver (5).
Funkkommunikationssystem nach Anspruch 7, bei dem die Vielzahl von Ausgängen (4) des Prozessorfeldes (1) mit einem konventionellen Ein-Antennen-Empfänger (5) gekoppelt sind.
The processor array as claimed in claim 3, in which each power supply switch is assigned a current limiting device.
Prozessor-Anordnung gemäß Anspruch 3, bei der jedem Energieversorgungs-Schalter eine Strombegrenzungs-Einrichtung zugeordnet ist.
The processor array as claimed in one of claims 1 to 5, in which the processor elements are arranged in matrix form in rows and columns.
Prozessor-Anordnung gemäß einem der Ansprüche 1 bis 5, bei der die Prozessorelemente matrixförmig in Zeilen und Spalten angeordnet sind.
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