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unité de prédécodage
in one embodiment, the predecode unit identifies a plurality of length vectors
selon une variante, l'unité de prédécodage identifie une pluralité de vecteurs de longueur
The instructions are selected from a quantity of bytes according to a predecode tag generated by the predecode unit.
Les instructions sont sélectionnées à partir d'une quantité d'octets selon une étiquette de prédécodage générée par l'unité de prédécodage.
The predecode unit is configured to generate a plurality of predecode bits for each instruction byte.
L'unité de prédécodage est configurée pour générer une pluralité de bits de prédécodage pour chaque octet d'instruction.
a predecode unit is configured to predecode a fixed number of instruction bytes of variable length instructions per clock cycle
une unité de prédécodage configurée pour prédécoder un nombre déterminé d'octets d'instructions de longueur variable par cycle d'horloge
A superscalar microprocessor having an instruction alignment unit, an instruction cache, a plurality of decode units and a predecode unit is provided.
L'invention concerne un microprocesseur superscalaire comprenant une unité d'alignement d'instructions, une mémoire cache d'instructions, une pluralité d'unités de décodage et une unité de prédécodage.
the predecode unit outputs predecode bits which identify whether any of the predecoded instruction bytes are the start byte of an instruction
l'unité de prédécodage sort des bits de prédécodage déterminant si un des octets d'instructions prédécodées est un octet de lancement d'une instruction
in one embodiment, the microprocessor includes a predecode unit, and instruction cache, a data cache, and a level two cache
dans un mode de réalisation, ledit microprocesseur comprend une unité de prédécodage, une antémémoire d'instructions, une antémémoire de données et une antémémoire à deux niveaux
the instruction cache is coupled to the predecode unit and comprises two pluralities of storage locations, one for storing instruction bytes and a second for storing predecode information corresponding to the instruction bytes
l'antémémoire d'instructions est couplée à l'unité de prédécodage et comporte deux groupes de plusieurs emplacements de mémoire, l'un pour mémoriser les octets d'instruction et l'autre pour mémoriser les informations de prédécodage correspondant à ces octets d'instruction
The predecode unit (12) is configured to receive instruction bytes from a level two cache (50) and generate corresponding predecode information.
L'unité de prédécodage (12) est configurée pour recevoir les octets d'instructions provenant d'une antémémoire de niveau deux (50) et pour produire des informations de prédécodage correspondantes.
The instruction cache (16) is configured to receive and store the instruction bytes and predecode information from the predecode unit (12).
L'antémémoire d'instructions (16) est configurée pour recevoir et mémoriser les octets d'instruction et les informations de prédécodage provenant de l'unité de prédécodage (12).
The predecode unit received instruction bytes and generates corresponding predecode information that is stored in the instruction cache with the instruction bytes.
L'unité de précodage reçoit des multiplets d'instructions et génère des informations de précodage correspondantes stockées dans l'antémémoire d'instructions avec lesdits multiplets d'instructions.
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