Vertaling van "CPLD" in Duits
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Un exemple de cette catégorie est l'équipement logique programmable complexe (CPLD).
Ein Beispiel dafür ist ein komplexer programmierbarer Logikbaustein (CPLD).
CPLD selon la revendication 3 ou la revendication 4, dans lequel : lesdits segments (201) sont agencés selon une configuration sensiblement symétrique autour de la GSM de telle sorte que la combinaison de la GSM et des segments s'apparente au moins à un polygone régulier.
CPLD nach Anspruch 3 oder 4, bei der die Segmente (201) in einem im wesentlichen symmetrischen Muster um die GSM angeordnet sind, so dass die Kombination aus der GSM und den Segmenten ungefähr ein regelmäßiges Polygon bildet.
XJTAG permet également la programmation à l'intérieur du système des FPGA, CPLD et mémoires Flash, et les clients XJTAG ont accès à une bibliothèque de scripts de test composant-centriques.
XJTAG ermöglicht auch die In-System-Programmierung von FPGAs, CPLDs, und Flash-Speichern. XJTAG Kunden erhalten den Zugang zu einer bauteilspezifischen Bibliothek mit Testskripten.
XJTAG permet également la programmation in situ des FPGA, CPLD et des mémoires Flash.
XJTAG ermöglicht auch die In-System-Programmierung von FPGAs, CPLDs, und Flash-Speichern.
Le CPLD dans les dispositifs de PSD comporte une architecture optimisée de logique de macrocell.
Das CPLD in den PSD-Geräten kennzeichnet eine optimierte macrocell Logikarchitektur.
Elle adopte la technologie de commande numérique, dont le noyau est MCU ultra-rapide et CPLD.
Es nimmt die Technologie der digitalen Steuerung an, von der der Kern Hochgeschwindigkeits-MCU und CPLD ist.
Si un composant JTAG configurable est disponible, par exemple un CPLD ou FPGA, alors acheminer la source d'horloge à travers ce composant vers la SDRAM ou tampon d'horloge pour maximiser la couverture de test comme indiqué ci-dessous.
Wenn ein konfigurierbares JTAG-Gerät, wie z.B. eine CPLD oder ein FPGA, verfügbar ist, führen Sie die Taktquelle über dieses Gerät zum SDRAM oder zum Taktgeber, um die Testabdeckung zu maximieren, wie unten gezeigt.
La famille de FastFLASH XC9500XL est une famille de 3.3V CPLD visée pour des applications performantes et de basse tension dans des communications marginales et des systèmes de calcul, où la dissipation de fiabilité élevée de dispositif et de puissance faible est importante.
Die Familie FastFLASH XC9500XL ist eine Familie 3.3V CPLD, die für die leistungsstarken, Schwachstromanwendungen in den führenden Kommunikationen und die Computing-Systeme anvisiert wird, in denen hohe Gerätzuverlässigkeits- und -Energienableitung wichtig ist.
Plus particulièrement, la Commission a examiné la relation verticale entre les services de fabrication sous contrat d'Intel et les activités d'Altera dans le domaine de la fourniture de FPGA et de CPLD.
Vor allem prüfte die Kommission die vertikale Beziehung zwischen den Werkvertragsdienstleistungen von Intel und Alteras Tätigkeiten im Bereich der Lieferung von FPGA und CPLD.
Utiliser la technologie CPLD dans le traitement des données pour éviter l'interférence des signaux électromagnétiques
Verwenden Sie CPLD-Technologie in der Datenverarbeitung, um die Interferenz elektromagnetischer Signale zu vermeiden
Un utilisateur peut configurer ces appareils en utilisant un éditeur de schémas ou à l'aide d'un langage de description de matériel (Verilog, VHDL) qui est compilé et enregistré dans la mémoire du CPLD.
Ein Benutzer kann diese Bausteine mittels eines Schaltbilds oder einer Hardwarebeschreibungssprache (Verilog, VHDL) konfigurieren, die kompiliert und in den CPLD-Speicher geladen wird.
Les modules Tactical Tracer se composent également de deux circuits intégrés (IC) supplémentaires : un microcontrôleur et un dispositif logique programmable complexe (CPLD).
Tactical Tracer-Module verfügen außerdem über zwei zusätzliche integrierte Schaltkreise (ICs) - einen Microcontroller und einen Complex Programmable Logic Device (CPLD).
Le JTAG n'est PAS SEULEMENT une technologie pour la programmation des FPGA / CPLD.
JTAG ist NICHT NUR eine Technologie für die Programmierung von FPGAs/CPLDs.
