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Système de commutation selon la revendication 9, dans lequel les huit premiers bits de chaque voie représentent un code d'instruction et les seize bits restants de chaque voie représentent de l'information de données.
Vermittlungssystem nach Anspruch 9, bei dem die ersten 8 Bits jedes Kanals einen Befehlscode repräsentieren und die verbleibenden 16 Bits jedes Kanals Dateninformationen repräsentieren.
Un dispositif à circuit intégré selon la revendication 3, dans lequel le registre (15) enregistre le code d'instruction qui est lu dans la première mémoire de programme (1a).
Integrierte Schaltungseinrichtung nach Anspruch 3, dadurch gekennzeichnet, daß das Register (15) den Befehlscode speichert, der aus dem ersten Programmspeicher (1a) ausgelesen wird.
Procédé selon la revendication 1, dans lequel un intervalle d'impulsion t représente une donnée "0", un intervalle d'impulsion de 2t représente une donnée "1", et ledit intervalle entre ledit code de demande et ledit code d'instruction est 4t.
Verfahren nach Anspruch 1, dadurch gekennzeichnet, dass ein Impulsintervall t Daten "0" darstellt, ferner ein Pulsintervall 2t Daten "1" darstellt, und das Intervall zwischen dem Spezialcode und dem Befehlscode 4t ist.
Procédé conforme à la revendication 1, comprenant en outre les étapes consistant à : stocker un champ intermédiaire (320) du code d'instruction (216) dans un registre (270) accessible à la séquence de codes.
Verfahren nach Anspruch 1, mit dem weiteren Verfahrensschritt: Speichern eines Zwischenfelds (320) des Befehlscodes (216) in einem Register (270), das für die Codefolge zugänglich ist.
Microprocesseur superscalaire selon la revendication 24, dans lequel un champ binaire du code d'instruction est substitué dans le format Op, le champ binaire de substitution étant déterminé en fonction du contexte de processeur (120).
Superskalarer Mikroprozessor nach Anspruch 24, bei dem ein Bitfeld des Befehlscodes in das Op-Format ersetzt ist, wobei das Ersatz-Bitfeld als eine Funktion des Kontextes des Prozessors (120) festgelegt ist.
Procédé selon la revendication 5, caractérisé en ce que toutes les routines de programme (BP, AP1, AP2) à répétition cyclique se terminent par le code d'instruction (AWAIT) qui appelle la routine d'attente se trouvant dans le microcode du processeur.
Verfahren nach Anspruch 5, dadurch gekennzeichnet, daß alle sich zyklisch wiederholenden Programmroutinen (BP, AP1, AP2) mit dem Befehlscode (AWAIT) enden, der die Warteroutine im Mikrocode des Prozessors aufruft.
Procédé selon la revendication 1, comprenant en outre l'étape consistant à : associer le premier code opératoire et le code d'échappement pour générer un deuxième code d'instruction, le deuxième code d'instruction représentant uniquement une deuxième opération réalisée par une deuxième instruction.
Verfahren nach Anspruch 1, wobei das Verfahren ferner folgendes umfasst: das Verknüpfen des ersten Operationscodes und des Umschaltcodes, so dass ein zweiter Befehlscode erzeugt wird, wobei der zweite Befehlscode eindeutig eine zweite Operation darstellt, die durch einen zweiten Befehl ausgeführt wird.
Procédé conforme à la revendication 4, dans lequel l'étape consistant à former le décalage comprend l'étape consistant à ajouter une valeur du champ de source (318) du code d'instruction à une valeur du champ de destination (316) du code d'instruction.
Verfahren nach Anspruch 4, wobei der Schritt des Bildens des Offsets das Addieren eines Wertes in dem Ursprungsfeld (316) des Befehlscode zu einem Wert in dem Zielfeld (316) des Befehlscodes umfaßt.
Procédé et dispositif pour effectuer une fonction assignée à un code d'instruction
Verfahren und Vorrichtung zur Durchführung einer Funktion, der ein Befehlskode zugewiesen ist
Méthode et appareil pour faciliter le partage de code d'instruction optimisé dans une machine virtuelle multi-tâches
Verfahren und Gerät für Teilung von optimiertem Befehlskode in einer virtuellen Maschine für Mehrfachaufgaben
Micro-ordinateur selon l'une des revendications 1 à 8, dans lequel le code d'instruction a une longueur de 8 bits.
Mikrocomputer nach einem der Ansprüche 1 bis 8, wobei der Instruktionscode die Länge von 8 Bits hat.
Un système de commande numérique selon la revendication 1, dans lequel un code d'instruction de fonctions diverses délivré dans ledit moyen d'interface est un signal de code M spécifié par deux chiffres en décimal codé binaire.
Numerisches Regelsystem nach Anspruch 1, bei dem ein Funktions-Befehlscode für die verschiedenartigen Funktionen, der in der Schnittstelleneinrichtung ausgegeben wird, ein M-Codesignal ist, das durch einen BCD-Wert bestehend aus zwei Ziffern spezifiziert ist.
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