Vertaling van "m bits" in Duits
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Procédé selon la revendication 1, caractérisé en ce que la représentation des m bits inférieurs sous forme de nombre positif est effectuée par extension en introduisant au moins un bit de plus fort poids supplémentaire, lequel est mis à zéro.
Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die Darstellung der unteren m Bits als positive Zahl durch eine Erweiterung um wenigstens ein zusätzliches höchstwertiges Bit, welches auf Null gesetzt wird, erfolgt.
Appareil selon la revendication 5, dans lequel le premier moyen d'insertion (13) comprend en outre un moyen (12) pour comprimer m bits de données en n bits de données.
Vorrichtung nach Anspruch 5, wobei die erste Einfügungseinrichtung (13) weiter eine Einrichtung (12) zur Kompression von m Bits Daten in n Bits Daten umfaßt.
Des sections sans chevauchement (z(i)) d'une séquence (z), ayant chacune m bits sont associées à des signaux (s(i)), où i = 1, 2, ... n d'une mémoire de signaux.
Aus einer Folge (z) werden sich nicht überschneidende Abschnitte (z(i)) von jeweils m Bits in Signalen (s(i)), i = 1, 2, ... n eines Signalvorrates zugeordnet.
Un procédé selon l'une quelconque des revendications 1 à 7, dans lequel chacun des groupes de bits entrelacés comprend m bits, en désignant par m un entier, et des symboles produits aux sorties des codeurs comprennent M symboles PSK, avec M = 2 m.
Verfahren nach einem der Ansprüche 1 bis 7, bei dem die verschachtelten Bit-Gruppen jeweils m Bits umfassen, wobei m eine ganze Zahl ist, und an den Ausgängen der Codierer erzeugte Symbole M-PSK-Symbole umfassen, worin M=2 m ist.
Micro-ordinateur selon la revendication 1, dans lequel ladite CPU inclut un tampon d'instructions (IRH, IRL) pour verrouiller une pluralité d'instructions exprimées sous la forme de 2 m bits.
Microcomputer nach Anspruch 1, wobei die CPU einen Befehlspuffer (IRH, IRL) zur Zwischenspeicherung mehrerer in 2 m Bits ausgedrückter Befehle aufweist.
Dispositif selon la revendication 8, où ledit moyen d'alignement décale à droite logiquement le dividende de M bits.
Vorrichtung nach Anspruch 8, bei der die Ausrichtungsmittel den Dividenden logisch um M Bits nach rechts verschieben.
Appareil selon la revendication 2, où des informations de données de sons à N bits sont emmagasinées dans ladite mémoire (4) après avoir été comprimées en M bits.
Gerät nach Anspruch 2, wobei die Tondateninformation von N Bits im Speicher (4) gespeichert wird, nachdem sie auf M Bits komprimiert wurde.
Dispositif selon la revendication 1, dans lequel l'information de commande spécifie que ladite information de détermination de l'état des M bits doit être interprétée comme une instruction de test algorithmique.
Gerät gemäß Anspruch 1, in dem die Steuerinformation spezifiziert, daß die Information zum Bestimmen des Status der M Bits als algorithmische Prüfanweisung zu interpretieren ist.
Procédé selon la revendication 1, où l'opération (1) comprend l'opération qui consiste à décaler logiquement à droite le dividende de M bits.
Verfahren nach Anspruch 1, bei dem Schritt (1) den Schritt des logischen Nach-Rechts-Verschiebens des Dividenden um M Bits umfasst.
8, 9, 12, 15) sur les deuxièmes données d'opérande des données d'entrée en parallèle, chacune des Q opérations produisant des deuxièmes données de résultat contenant N bits, et un registre de destination de M bits (Fig.
8, 9, 12, 15) an den zweiten Operandendaten der Eingangsdaten, wobei jeder der Q Vorgänge zweite Ergebnisdaten erzeugen, die N Bits enthalten; und ein Bestimmungsregister von M Bits (Fig.
Arrangement pour la conversion d'un signal binaire de m bits en signal analogique.
Einrichtung zum Umsetzen eines m Bit breiten Binärsignals in ein Analogsignal.
Le commutateur de paquets (100) selon la revendication 4, caractérisé en outre en ce que le chemin de données de y bits est deux fois plus large que le chemin de données de m bits.
Die Paketvermittlungseinrichtung (100) gemäß Anspruch 4, ferner dadurch gekennzeichnet, daß der y-Bit breite Datenpfad die zweifache Breite des m-Bit breiten Datenpfads aufweist.
Appareil de transmission de données selon la revendication 6, dans lequel ledit signal de remise à l'état initial de bus est un code de commande ayant 2 symboles attribués de codes à m bits.
Datenübertragungsvorrichtung nach Anspruch 6, wobei das Bus-Rücksetzsignal ein Steuercode ist, der zwei zugeteilte Symbole aus m-Bit-Codes hat.
