Vertaling van "n bits" in Duits
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Dispositif selon la revendication 12, dans lequel les blocs numériques de texte en clair et de texte chiffré font tous deux n bits de long.
Vorrichtung nach Anspruch 12, wobei die digitalen Blöcke von Klartext und Chiffretext beide n Bits in der Länge sind.
Procédé selon la revendication 2, caractérisé en ce que ladite étape de calcul dudit syndrome s comprend l'étape consistant à entrer séquentiellement lesdits n bits reçus dans ledit diviseur du type à registre à décalage.
Verfahren nach Anspruch 2, dadurch gekennzeichnet, daß der Schritt der Berechnung des Syndroms s den Schritt eines sequentiellen Einspeisens der empfangenen n Bits in das Schieberegister vom Typ eines Teilers umfaßt.
Une résolution de n bits correspond à une quantification de 2n niveaux.
Eine Auflösung von n Bit entspricht einer Quantisierung von 2n Zuständen.
Circuit selon une des revendications 2 à 5, caractérisé en ce que les moyens (5) pour la formation de la moyenne et l'unité combinatoire (6) traitent deux des n bits du signal numérique binaire (DS).
Schaltungsanordnung nach einem der Ansprüche 2 bis 5, dadurch gekennzeichnet, daß die Mittel zur Mittelung (5) und die Verknüpfungseinheit (6) zwei der n Bit des binären Datensignals (DS) verarbeiten.
Coprocesseur selon l'une des revendications 3 à 9, caractérisé en ce que les premier, deuxième, troisième et quatrième registres (40, 10, 11 et 12) ont une taille identique de n bits.
Koprozessor nach einem der Ansprüche 3 bis 9, dadurch gekennzeichnet, daß das erste, zweite, dritte und vierte Registers (40, 10, 11 und 12) eine Größe von n Bits haben.
Un algorithme, qui est fondé sur un registre à décalage (25) à rétroaction (27) avec n bits, est utilisé.
Dabei wird ein Algorithmus basierend auf einem rückgekoppelten (27) Schieberegister (25) mit n Bits verwendet.
Appareil selon la revendication 5, dans lequel le premier moyen d'insertion (13) comprend en outre un moyen (12) pour comprimer m bits de données en n bits de données.
Vorrichtung nach Anspruch 5, wobei die erste Einfügungseinrichtung (13) weiter eine Einrichtung (12) zur Kompression von m Bits Daten in n Bits Daten umfaßt.
Appareil d'exposition par faisceau de particules chargées selon la revendication 24, caractérisé en ce que lesdits n registres à décalage (5, 19d) reçoivent successivement des données de motif différent à raison de n bits à la fois suivant la direction de colonne.
Die Ladungsteilchenstrahlbelichtungsvorrichtung nach Anspruch 24, dadurch gekennzeichnet, daß die genannten n Schieberegister (5, 19d) verschiedene Musterdaten, immer n Bits auf einmal, längs der Spaltenrichtung sukzessive empfangen.
Procédé selon la revendication 5, caractérisé en ce qu'au moins quelques-unes des séries (2(0),...,2 (n)) de n bits sont des séries différentes et qu'au moins les méthodes de substitution prédéterminées sont des méthodes de substitution différentes.
Verfahren nach Anspruch 5, dadurch gekennzeichnet, dass mindestens einige der Folgen (2(0), ..., 2(n)) von n Bits verschiedene Folgen sind, und dass mindestens die vorbestimmten Substitutionsverfahren verschiedene Substitutionsverfahren sind.
Détecteur de phase selon la revendication 1, caractérisé en ce que les signaux numériques possèdent une longueur de mot de n bits, le bit de poids maximum (MSB) contenant l'information de signe et les n-1 autres bits contenant la valeur d'amplitude.
Phasendetektor nach Anspruch 1, dadurch gekennzeichne t, daß die digitalen Signale eine Wortlänge von n Bit aufweisen, wobei das höchstwertige Bit (MSB) die Vorzeicheninformation enthält und die restlichen n-1 Bit den Amplitudenwert.
Convertisseur D/A selon la revendication 13, caractérisé en ce que ledit un (D₂₀) desdits n bits dudit signal numérique est un bit le plus significatif dudit signal numérique.
D/A-Konverter nach Anspruch 13, dadurch gekennzeichnet, daß das eine (D₂₀) der n Bits des Digitalsignals ein höchstwertiges Bit des Digitalsignals ist.
Les n bits d'un état itéré N' fois de l'ensemble registre à décalage sont ainsi obtenus.
Dabei werden die n Bit eines N'-fach iterierten Zustands der Schieberegisteranordnung erhalten.
Micro-ordinateur selon la revendication 2, dans lequel ladite CPU inclut en outre un registre d'instructions (IR1, IR2) pour verrouiller des instructions de 2 n bits, qui sont acheminées à partir dudit tampon d'instructions, à un instant prédéterminé.
Microcomputer nach Anspruch 2, wobei die CPU ferner ein Befehlsregister (IR1, IR2) aufweist, um von dem Befehlspuffer zugeführte Befehle mit 2 n Bits zu einem vorgegebenen Zeitpunkt zwischenzuspeichern.
