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procédé et dispositif de validation de conception de circuits intégrés complexes sans simulation logique
method and apparatus for design validation of complex ic without using logic simulation
modèle d'analyse de chronologie et système de détermination des caractéristiques pour la simulation logique de circuits intégrés
timing model and characterization system for logic simulation of integrated circuits
Les systèmes numériques sont généralement validés en distribuant des tâches de simulation logique parmi d'immenses grappes de serveurs pour plusieurs semaines à la fois.
Digital systems are typically validated by distributing logic simulation tasks among huge compute farms for weeks at a time.
Le noeud d'activation en fournissant cet accès extérieur facilite la simulation logique, la vérification et/ou la gradation des erreurs des circuits contenant cette variante du détecteur de phase.
By providing this external access, the initiallization node facilitates logic simulation, testing and/or fault grading of circuits containing this phase detector embodiment.
L'outil peut également effectuer une simulation logique et estimer la surface de circuit, la consommation d'énergie et les performances au niveau de la porte.
The tool can also perform logic simulation and estimate circuit area, power consumption, and performance at the gate level.
Dans un simulateur logique, une erreur courante dans l'évaluation de l'exactitude de modèles est de comparer un modèle de simulation logique à un modèle de simulation de circuit à transistor.
In logic simulation, a common mistake in evaluation of accurate models is to compare a logic simulation model to a transistor circuit simulation model.
De façon spécifique, certains modes de réalisation garantissent que la simulation suit une sémantique de matériel en manipulant correctement des conditions de capacité dans des éléments d'état et/ou des rafales dans des arbres d'horloge pouvant se produire lors d'une simulation logique.
Specifically, some embodiments ensure that the simulation follows hardware semantics by properly handling race conditions in state elements and/or glitches in clock trees that can occur during logic simulation.
le procédé de validation de conception permet d'éliminer une simulation logique, qui constitue un goulot d'étranglement dans la validation de conception actuelle
the design validation method eliminates logic simulation which is a bottleneck in design validation today
procédé de simulation logique et simulateur logique
logic simulation method and logic simulator
Le système (2) crée une filière maître (40) et une ou plusieurs filières esclaves (41) pour exécuter l'algorithme de simulation logique entraînée par les événements sur une plate-forme (25) multiprocesseur ou à processeur unique.
The system (2) creates a master thread (40) and one or more slave treads (41) for executing the event driven logic simulation algorithm on the single or multiprocessor platform (25).
Une section de vérification (3) vérifie si le signal ou le réglage au moment de la simulation logique satisfait la spécification physique ou non, et si la spécification physique n'est pas satisfaite, unesection de sortie d'avertissement (4) émet un avertissement.
A checking section (3) checks whether the signal or setting at the time of logic simulation satisfies the physical specification or not, and if the physical specification is not satisfied, a warning output section (4) issues a warning.
Le noyau d'un simulateur à évènements discrets est détaillé, ainsi qu'un modèle général pour la simulation logique, qui permet une vitesse de simulation de 50000 évènements par seconde et par MIPS, sur machine séquentielle.
The kernel of an event driven simulator is detailed, along with a general purpose model for logic simulation, which enables simulation speed of 50000 events per second per MIPS, on sequential computers.
Le paragraphe 3D003 ne vise pas le "logiciel" spécialement conçu pour la saisie du schéma, la simulation logique, le placement et le routage, la vérification du schéma ou la bande de génération de schéma.
3D003 does not control "software" specially designed for schematic entry, logic simulation, placing and routing, layout verification or pattern generation tape.
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