Vertaling van "HDL Coder" in Engels
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Los algoritmos de esta toolbox están diseñados para generar código legible y sintetizable en VHDL y Verilog (con HDL Coder).
The toolbox algorithms are designed to generate readable, synthesizable code in VHDL and Verilog (with HDL Coder).
Usando HDL Coder, usted puede convertir automáticamente código MATLAB de punto flotante a punto fijo y generar sintetizable VHDL y Verilog código.
Learn how you can target algorithms written in MATLAB to Altera FPGAs using HDL Coder.
A continuación, se puede emplear HDL Coder para generar RTL sintetizable para VHDL o Verilog.
You can then use HDL Coder to generate synthesizable VHDL or Verilog RTL.
Todos están listos para generar Verilog o VHDL mediante HDL Coder.
All are ready to generate Verilog or VHDL using HDL Coder.
Automatice las tareas de verificación de HDL gracias al uso de HDL Verifier con HDL Coder.
Automate HDL verification tasks by using HDL Verifier with HDL Coder.
Este curso de dos días muestra cómo generar y verificar código HDL desde modelos de Simulink utilizando HDL Coder y HDL Verifier.
This two-day course shows how to generate and verify HDL code from a Simulink model using HDL Coder and HDL Verifier.
Por ejemplo, puede generar archivos de encabezado C, archivos de coeficientes de Xilinx (COE) (con la caja de herramientas del sistema DSP) y VHDL, Verilog junto con bancos de pruebas (con diseño de filtro HDL Coder).
For example, you can generate C header files, XILINX coefficients(COE) files (with the DSP System Toolbox) and VHDL, Verilog along with test benches (with Filter Design HDL Coder).
HDL Coder proporciona un asesor de flujo de trabajo que automatiza la programación de FPGA Xilinx, Microsemi e Intel.
HDL Coder provides a workflow advisor that automates the programming of Xilinx, Microsemi, and Intel FPGAs.
HDL Coder genera código Verilog y VHDL transferible y sintetizable a partir de funciones de MATLAB, modelos de Simulink y gráficos de Stateflow.
HDL Coder generates portable, synthesizable Verilog and VHDL code from MATLAB functions, Simulink models, and Stateflow charts.
Utilizando DSP System Toolbox con Filter Design HDL Coder en MATLAB, puede diseñar filtros digitales y generar código VHDL y Verilog eficiente, sintetizable y portátil para su implementación en FPGAs o ASICs.
Using DSP System Toolbox with Filter Design HDL Coder in MATLAB, you can design digital filters and generate efficient, synthesizable, and portable VHDL and Verilog code for implementation in FPGAs or ASICs.
Usted puede utilizar el HDL Coder para generar código VHDL y Verilog deSimulink y Stateflow.
Converting floating-point MATLAB algorithms to fixed-point Generating VHDL and Verilog code directly from MATLAB using HDL Coder
Utilizando DSP System Toolbox con Filter Design HDL Coder en MATLAB, puede diseñar filtros digitales y generar código VHDL y Verilog eficiente, sintetizable y portátil para su implementación en FPGAs o ASICs.
Design digital filters and generate efficient, synthesizable, and portable VHDL and Verilog code for implementation in FPGAs or ASICs. Learn more Product Resources
