Vertaling van "IP-Core" in Engels
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Mit dem neuen IP-Core können Entwickler das hohe Sicherheitsniveau von AURIX mit dem großen funktionalen Spielraum der Xilinx-Produkte kombinieren.
Now, the new IP core will allow system developers to combine safety and security provided by AURIX with the wide range of functional possibilities brought to the table by the Xilinx devices.
Der neue IP-Core und das Entwicklungs-Kit sind ab März 2019 verfügbar.
The new IP core and the development kit will be available starting in March 2019.
Auch wenn Camera Link HS ein paketbasiertes Protokoll ist, erreicht sie Trigger-Jitter von 6,4 Nanosekunden (ns) durch den IP-Core mit typischen Latenzzeiten von 150 ns, GPIO-Latenz und Jitter in Bereichen von 300 ns.
Even though Camera Link HS is a packet based protocol, it achieves trigger jitter of 6.4 nanoseconds (ns) using the IP core with typical latencies of 150 ns and GPIO latency and jitters in the 300 ns range.
Ein derartiges Paket dient als umfassende Basis für einen Bildsensor, der den SLVS-EC RX IP-Core integriert.
This development kit provides a complete foundation for the image sensor to incorporate an SLVS-EC RX IP Core.
Mit dem TSN IP-Core bieten Entwickler am Fraunhofer IPMS Anlagenherstellern und -betreibern die Möglichkeit, ihre Geräte für die neuen TSN-Standards fit zu machen.
With the TSN IP Core, developers at Fraunhofer IPMS provide equipment manufacturers and operators the opportunity to make their devices fit for new TSN standards.
Suska-III-T: Die Arbeiten am IP-Core des kleinsten aber leistungsfähigsten Suska-Geräts gestalten sich am komplexesten.
Suska-III-T: the work on the ip core of the smallest but most performant Suska board is turning out to be most complex of all.
Erfahren Sie mehr über den DVB-RCS2 Turbo Decoder IP-Core.
Learn more about the DVB-RCS2 turbo decoder IP core.
Die Logik ist von DOMOLOGIC als IP-Core verfügbar, implementiert in portierbarem VHDL Code.
The logic is available from DOMOLOGIC as IP core, written in portable VHDL code.
Der Creonic DVB-C2 IP-Core integriert die im Standard vorgesehene Fehlerkorrektur (LDPC und BCH Decoder).
The Creonic DVB-C2 IP core integrates the forward error correction as defined by the standard (including LDPC and BCH decoder).
Der Creonic DVB-RCS2 Turbo Decoder IP-Core wird für ASIC- und FPGA-Technologien angeboten und kann an verschiedene Durchsatzanforderungen angepasst werden.
The Creonic DVB-RCS2 turbo decoder IP core will be available for ASIC and FPGA technology and can be tailored to different throughput requirements.
Vieworks Co., Ltd als ein führender Entwickler digitaler Bildverarbeitungslösungen für die Medizin, ist eines der ersten Unternehmen, welches den FRAMOS SLVS-EC RX IP-Core für Xilinx-FPGAs einsetzt.
Vieworks Co. Ltd., is a leading developer of advanced digital medical imaging solutions. It is one of the pioneer companies using the recently released SLVS-EC RX IP Core for Xilinx FPGAs from global imaging expert FRAMOS.
Um Embedded Vision-Systeme zu unterstützen, wird FRAMOS auch seinen neuen SLVS-EC RX IP-Core zur einfachen Sensoranbindung an Xilinx-FPGAs vorstellen.
To support the building of embedded vision systems FRAMOS will also be showcasing their new SLVS-EC RX IP Core for easy sensor interfacing with FPGAs from Xilinx.
Der IP-Core kann mit eigenen FPGA-Designs kombiniert oder in System-on-Chips (SoCs) mit Softcore-Prozessoren oder Hard-Prozessorsystemen über AMBA-AXI-Schnittstellen integriert werden.
The IP core (ET1810) can be combined with own FPGA designs and offers the option of communicating with a soft core processor via the Avalon Interface.
