Vertaling van "der Pull-down-Transistor" in Engels
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the pull-down transistor
said pull-down transistor
Anzeigevorrichtung nach Anspruch 6, wobei der Pull-up-Transistor später als der Pull-down-Transistor bezüglich der Scanzeitlage erregt wird.
A display apparatus according to claim 6, wherein said pull-up transistor is energized later than said pull-down transistor with respect to said scanning timing.
CMOS-Klemmschaltung nach Anspruch 5, bei der der Aktivierungstransistor (P7) ausgeschaltet und der Pull-down-Transistor (N7) eingeschaltet ist, wenn sich das komplementäre Aktivierungsklemmsignal auf einem Logik-High-Pegel befindet.
A CMOS clamp circuit as claimed in claim 5, wherein said enabling transistor (P7) is turned off and said pull-down transistor (N7) is turned on when said complementary activate clamp signal is at a high logic level.
MNTL-Schaltung nach Anspruch 1, bei der der Pull-Down-Transistor an seiner Basis mit einem Punkt verbunden ist, der mit einem Eingangsspannungsanschluß verbunden ist.
An MNTL circuit according to Claim 1, wherein said pull down transistor is connected at a base to a point connected with an input voltage terminal.
Latch-gesteuerter Ausgangstreiber nach einem der vorstehenden Ansprüche, bei welchem der Pull-up-Transistor (D1) ein p-Kanal Feldeffekttransistor und der Pull-down-Transistor (T2) ein n-Kanal Feldeffekttransistor ist.
The latch controlled output driver of any preceding claim, wherein the pull-up transistor (T1) is a p-channel field effect transistor and the pull-down transistor (T2) is an n-channel field effect transistor.
Latchgesteuerte Ausgangstreiberschaltung nach Anspruch 2, bei der der Pull-up-Transistor und der Pull-down-Transistor ein n-Kanal-MOSFET ist.
The latch controlled output driver circuit of claim 2, wherein the pull-up transistor and the pull-down transistor are n-channel MOSFETs.
Der Pull-Down-Transistor Q2 wird in Abhängigkeit von dem logisch hohen Signal auf dem Knoten N2 angeschaltet, um logisch niedrige Ausgabedaten Dout auf der Datenaus gabeleitung N3 zu erzeugen.
The pull-down transistor Q2 is turned on in response to the high logic signal on the node N2 to generate low logic output data Dout on the data output line N3.
Wenn der Pull-Down-Transistor Q2 angeschaltet ist, wird die Spannung auf der Datenausgabeleitung N3 zur Erdpotentialquelle Vss übertragen.
As the pull-down transistor Q2 is turned on, a voltage on the data output line N3 is transferred to the ground voltage source Vss.
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