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LabVIEW FPGA code to
Examples with "LabVIEW FPGA code to" and their translation in Duits
Methods are also provided to synchronize your LabVIEW FPGA code to the RIO Scan Interface I/O updates.
Des Weiteren werden Methoden bereitgestellt, um den LabVIEW-FPGA-Code mit den Updates der RIO-Scan-Interface-I/O zu synchronisieren.
This means you can optimize more LabVIEW FPGA code to fit within Virtex-5 FPGAs and execute more operations per clock cycle.
Dies bedeutet, dass mehr LabVIEW-FPGA-Code in einem Virtex-5-FPGA untergebracht werden kann und mehr Operationen pro Taktrate ausgeführt werden können.
Andere resultaten
The following LabVIEW FPGA code shows a how to generate a PWM output signal
Der folgende LabVIEW-FPGA-Code zeigt, wie ein PWM-Ausgangssignal erzeugt wird
For fixed-point filters, you can model quantization effects, optimize numeric representation/topology, and deploy the design on a digital signal processor or field-programmable gate array (FPGA) using automatically generated ANSI C or LabVIEW FPGA code.
Bei Festkommafiltern können Anwender Quantisierungseffekte modellieren, numerische Darstellungen/Topologien optimieren und den Entwurf mithilfe von automatisch erzeugtem ANSI-C- oder LabVIEW-FPGA-Code auf ein DSP oder FPGA übertragen.
With the NI LabVIEW FPGA Module, you can use familiar LabVIEW code to customize instrumentation hardware.
1: Dank des NI LabVIEW FPGA Module lässt sich LabVIEW-Code zur benutzerdefinierten Anpassung von Messgeräten einsetzen.
Shift the LabVIEW control code to hardware logic in the on-board FPGA if further isolation and hardware reliability is required.
Sollte weitere Isolierung und Hardwarezuverlässigkeit nötig sein, kann der LabVIEW-Steuercode an die Hardwarelogik des integrierten FPGA ausgelagert werden.
In addition to using the LabVIEW FPGA algorithm functions, the slave chassis provides several chassis I/O signals to help customize and synchronize your code.
Neben der Verwendung der LabVIEW-FPGA-Algorithmusfunktionen bietet das Slave-Chassis mehrere Chassis-I/O-Signale, um Anwender bei der Anpassung und Synchronisation des Codes zu unterstützen.
Plus, adding hardware-level FPGA code to your EtherCAT RIO slaves gives you the ability to offload processing from the controller and reduce response time by making intelligent decisions at the node.
Außerdem ermöglicht die Ergänzung der EtherCAT-Slaves um anwenderdefinierten FPGA-Code auf Hardwareebene die Auslagerung der Signalverarbeitungsleistung vom Controller auf das dezentrale System.
With LabVIEW FPGA, digital signal processing algorithms and digital protocols can be defined during product research and development and then reused as part of device or component verification-eliminating the need to generate test code from scratch.
Mit LabVIEW FPGA können Algorithmen zur digitalen Signalverarbeitung definiert und anschließend als Teil der Geräte- oder Komponentenprüfung wiederverwendet werden, so dass Prüfcode nicht von Grund auf erstellt werden muss.
The Case structure in LabVIEW FPGA is powerful, because it essentially represents a hardware trigger for all the code it encapsulates.
Die Case-Struktur in LabVIEW FPGA ist äußerst leistungsstark, denn sie ist im Grunde ein Hardwaretrigger für den gesamten Code, den sie umschließt.
Now it is easy to integrate code libraries into LabVIEW Real-Time applications, or even develop custom standalone executables that interface directly to LabVIEW FPGA applications.
C-Bibliotheken können nun in LabVIEW-Real-Time-Anwendungen integriert werden. Auch das Erstellen ausführbarer Dateien ist möglich, die über eine Schnittstelle direkt mit LabVIEW-FPGA-Anwendungen kommunizieren.
You can program the FPGA in the NI Digital Electronics Board using LabVIEW with the LabVIEW FPGA Module or with Xilinx ISE tools using either VHDL or Verilog code.
Der FPGA kann mithilfe von LabVIEW mit dem LabVIEW FPGA Module oder mit Xilinx-ISE-Werkzeugen mithilfe von VHDL- oder Verilog-Code programmiert werden.
The design of the PXI-4110 made extensive use of the LabVIEW graphical programming language to simulate the software PID and then translate the code to VHDL to run on the FPGA.
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