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Le convertisseur série-parallèle comprend en outre un certain nombre de bascules de sortie pour sortir les bits de données en parallèle en réponse à un signal d'horloge de sortie.
The serial-to-parallel converter further includes a number of output flip-flops to output the data bits in parallel in response to an output clock signal.
Chaque circuit de commande /réception comprend un circuit de commande possédant des bascules de sortie d'adresse et de donnees et des portes de commande, ainsi qu'un circuit de réception possédant des bascules d'entree d'adresse et de donnees.
Each driver/receiver circuit comprises a driver circuit having address and data output latches and driver gates, and a receiver circuit having address and data input latches.
deux de ces arborescences d'horloge sont locales par rapport à l'interface e/s et déclenchent plusieurs bascules de sortie configurées à la volée pour mettre en mémoire tampon les signaux de données de sortie provenant du noyau en mode asynchrone ou synchrone
two of the clock trees are local to the i/o interface and trigger a plurality of output latches configured on-the-fly to buffer output data signals from the core in asynchronous or synchronous mode
le dernier étage de sortie à verrouillage qui comprend un tampon de sortie intégré est construit en tant que tel différemment des autres bascules de sortie, lesquelles bascules comprennent des verrous maîtres et asservis
the last output latch stage includes an integral output buffer, and as such is constructed differently from the other output flip-flops through 32n), which include master and slave latches
a cet effet, les bascules d'entrée et les bascules de sortie sont disposées de sorte qu'elles forment respectivement au moins un bloc d'entrée et un bloc de sortie avec des domaines d'impulsion propres qui se différencient des domaines d'impulsion du coeur restant.
for this purpose, the input FFs and the output FFs are arranged in such a manner that they form at least one input block and one output block each with respective clock domains that differ from the clock domains of the remaining core.
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