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Ces réseaux sont appelés LDA ("Low-Density Construction A") et sont caractérisés par des matrices de parité p-aires creuses, qui les mettent en relation directe avec les codes LPDC.
These lattices are called LPA (Low-Density Construction A) and are characterised by sparse p-ary parity-chedk matrices, that put them in direct relation with LPDC codes.
DÉCODAGE DE CODES LPDC À EFFACEMENT POUR MÉMOIRES FLASH
Si le décodeur de codes LPDC à décision dure détecte une erreur non corrigible, alors le contrôleur SSD utilise un décodeur de codes LPDC à décision dure à lecture à 1,5 bit (deux lectures) pour accéder à la mémoire flash.
If the hard-decision LDPC decoder detects an uncorrectable error, then the SSD controller uses a 1.5-bit read (two reads) erasure-decision LDPC decoder to access the flash memory.
La mémoire flash ayant un TEB brut entre deux autres valeurs prédéterminées, le contrôleur SSD omet l'utilisation du décodeur de codes LPDC à décision d'effacement pour accéder à la mémoire flash.
With flash memory having a raw BER between two other predetermined values, the SSD controller omits the use of the hard-decision LDPC decoder and uses only the erasure -decision LDPC decoder to access the flash memory.
Une mémoire flash SLC ayant un TEB inférieur à une valeur prédéterminée, le contrôleur SSD utilise un décodeur de codes LPDC à décision dure à lecture à 1 bit (lecture unique) pour accéder à la mémoire flash.
With SLC flash memory having a BER less than a predetermined value, the SSD controller uses a 1-bit read (single read) hard-decision LDPC decoder to access the flash memory.
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