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coder generates
Traduction de "coder generates" en français
Coder génère
Embedded Coder generates single-rate or multirate code using periodic sample times specified in the model.
Embedded Coder génère un code monocadence ou multicadence en fonction des périodes d'échantillonnage périodique spécifiées dans le modèle.
Embedded Coder generates readable, compact, and fast C and C++ code for use on embedded processors, on-target rapid prototyping boards, and microprocessors used in mass production.
Embedded Coder génère un code C et C++ lisible, compact et rapide pouvant être utilisé sur les processeurs embarqués, les cartes de prototypage rapide sur cible et les microprocesseurs utilisés dans la production en grande série.
Generating a Main Program Embedded Coder generates an extensible main program based on information you provide for deploying the code in your real-time environment.
Embedded Coder génère un programme principal extensible en fonction de l'information fournie pour le déploiement du code dans votre environnement en temps réel.
GPU Coder generates optimized CUDA code from MATLAB code for deep learning, embedded vision, and autonomous systems.
GPU Coder génère du code CUDA optimisé à partir de code MATLAB pour le Deep Learning, la vision embarquée et les systèmes autonomes.
Simulink PLC Coder generates test benches that help you verify the Structured Text and Ladder Diagrams using PLC and PAC IDEs and simulation tools.
Simulink PLC Coder génère des test benches vous permettant de vérifier le texte structuré et les schémas à contacts au moyen des IDE PLC et PAC et des outils de simulation.
Verifying HDL Code HDL Coder generates VHDL and Verilog test benches for rapid verification of generated HDL code.
Vérification du code HDL HDL Coder génère des bancs d'essai VHDL et Verilog pour la vérification rapide du code HDL généré.
HDL Coder generates VHDL and Verilog that meets popular industry coding guidelines such as RMM and STARC.
HDL Coder génère du code VHDL et Verilog conforme aux normes de codage les plus répandues sur le marché, comme RMM et STARC.
HDL Coder generates readable, traceable, synthesizable VHDL or Verilog HDL.
HDL Coder génère du code VHDL ou Verilog lisible, traçable et synthétisable.
Simulink Coder generates C and C++ for Simulink models, MATLAB functions, and Stateflow charts.
Simulink Coder génère du code C et C++ pour des modèles Simulink, des fonctions MATLAB et des diagrammes Stateflow.
Simulink PLC Coder generates optimized, well-integrated code for Simulink, Stateflow, and MATLAB functions.
Simulink PLC Coder génère du code optimisé et bien intégré pour Simulink, Stateflow et les fonctions MATLAB.
Simulink PLC Coder generates Structured Text in a variety of file formats used by third-party IDEs, including Siemens STEP 7/TIA Portal, Rockwell Automation Studio 5000, 3S CODESYS, and PLCopen XML.
Simulink PLC Coder génère du texte structuré dans de nombreux formats de fichiers utilisés par des IDE tiers, notamment Siemens STEP 7/TIA Portal, Rockwell Automation Studio 5000, 3S CODESYS et PLCopen XML.
the speech coder generates a target vector (p) based on an input signal (s)
le codeur de parole génère un vecteur cible (p) basé sur un signal d'entrée (s)
After generating the candidate list for a PU, the video coder generates a predictive video block for the PU based on one or more reference blocks indicated by motion information of the PU.
Après avoir généré la liste de candidats pour un PU, le codeur vidéo génère un bloc vidéo de prédiction pour le PU, sur la base d'un ou plusieurs blocs de référence indiqués par des données de mouvement du PU.
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Synonymes et analogies de "coder generates" en anglais
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