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algorithm HDL model
Vertaling van "algorithm HDL model" in Duits
Algorithmus-HDL-Modell
We implemented the algorithm HDL model as fixed point since fixed-point operations consume fewer resources on FPGAs.
Wir implementierten das Algorithmus-HDL-Modell mit dem Festkomma-Datentyp, weil Festkomma-Operationen auf FPGAs weniger Ressourcen verbrauchen.
Once we had functionally correct models with the desired component rates, we grouped all components intended for C code generation into an algorithm C model and all components intended for HDL code generation into an algorithm HDL model (Figure 6).
Als wir funktional korrekte Modelle mit den gewünschten Komponentenraten vorliegen hatten, gruppierten wir alle für die C-Codegenerierung vorgesehenen Komponenten in einem Algorithmus-C-Modell und alle Komponenten für die HDL-Codegenerierung in einem Algorithmus-HDL-Modell (Abbildung 6).
Andere resultaten
Figure 6. Controller algorithm models for C and HDL code generation.
Abbildung 6: Modelle des Regelungsalgorithmus für die C- und HDL-Codegenerierung.
MATLAB and Siimulink products you can automatically generate HDL code from your models, speeding up the implementation of your algorithms on FPGAs.
Mit MATLAB- und Simulink-Produkten können Sie automatisch HDL-Code von Ihren Modellen erzeugen und so die Implementationen Ihrer Algorithmen auf FPGAs beschleunigen.
Generate efficient RTL from Vision HDL Toolbox blocks and subsystems, which model streaming hardware implementations of vision processing algorithms.
Generieren Sie effizienten RTL-Code aus Blöcken und Subsystemen von Vision HDL Toolbox, die Streaminghardware-Implementierungen von Bildverarbeitungsalgorithmen modellieren.
We were then able to automate integration of the generated algorithm HDL code with our hand code, build a bitstream, and download it to the FPGA.
Dann konnten wir die Integration des generierten Algorithmus-HDL-Codes mit unserem manuellen Code automatisieren, einen Bitstream erstellen und ihn auf das FPGA herunterladen.
With these modeling techniques HDL models can be created, whose behavior optimally can be adjusted to specific simulation tasks and requirements, by activating or deactivating model properties, resulting in considerable time savings in the verification process.
Mit diesen Modellierungstechniken konnten HDL-Modelle geschaffen werden, deren Verhalten durch Aktivieren oder Deaktivieren von Modelleigenschaften optimal an die spezifischen Simulationsaufgaben bzw. -anforderungen anpassbar sind, was zu erheblicher Zeitersparnis im Verifikationsprozess führt.
Include HDL models in larger-scale system models developed and simulated in Simulink
HDL-Modelle in umfassendere Systemmodelle einbinden, welche in Simulink entwickelt und simuliert wurden
Through cosimulation with third-party HDL simulators you can automate the verification of handwritten or automatically generated HDL code - you quickly verify your HDL designs against the original algorithm specification by reusing your models as test benches.
Durch Parallelsimulation mit Drittanbieter-HDL-Simulationen können Sie die Verifikation der Hardware automatisieren, unabhängig davon, ob von Hand erstellter oder automatisch erzeugter HDL-Code betroffen ist - Sie verifizieren Ihre HDL-Entwicklungen gegen die ursprünglichen Algorithmus-Spezifikationen indem Sie Ihre Modelle als Teststände wiederverwenden.
These models can be used to create software test benches for HDL implementations or substituted as algorithms in place of HDL blocks or subsystems for HDL debugging or verification.
Diese Modelle können dann für die Entwicklung von Software-Prüfständen für HDL-Implementierungen verwendet werden oder beim HDL-Debugging oder der HDL-Verifizierung in Form von Algorithmen als Ersatz für HDL-Blöcke bzw. Untersysteme dienen.
Deploy algorithms and models to your choice of in-operation systems such as embedded systems, edge devices, and the cloud by automatically generating C/C++, Python, HDL, PLC, GPU, .NET, or Java based software components.
Bereitstellung von Algorithmen und Modellen für im Betrieb befindliche Systeme wie Embedded Systeme, Edge-Geräte und die Cloud durch automatische Generierung von Softwarekomponenten auf Basis von C/C++, Python, HDL, PLC, GPU, .NET oder Java.
From model to FPGA system-on-chip (SoC), see the implementation of a motor regulation-algorithm on a heterogeneous SoC made of an FPGA and an ARM9 processor through IP core generation workflows and automatic HDL- and C-code generation.
Vom Modell zum System-on-Chip (SoC) FPGA: Vorgestellt werden die Implementierung eines Motor-Regelungsalgorithmus auf einem heterogenen SoC, bestehend aus einem FPGA und einem ARM9 Prozessor, der IP Core Generation Workflow und die automatische HDL- und C-Codegenerierung.
Synoniemen voor algorithm HDL model in het Engels
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