Examples with "the address decoder" and their translation in Duits
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Apparatus of claim 3 characterized in that it comprises a data strobe line connected to the address decoder (110) for providing timing signals.
Gerät nach Anspruch 3, dadurch gekennzeichnet, daß es eine Datentaktleitung umfaßt, verbunden mit dem Adressdekoder (110) für das Bereitstellen von Zeitlagesignalen.
Data-processing device according to Claim 5, characterized in that, when there are a plurality of secret keys (Key1, Key2), the respectively current key can be selected by means of the address decoder (AD) as a function of the addressed memory area.
Datenverarbeitungseinrichtung nach Anspruch 5, dadurch gekennzeichnet, daß bei mehreren geheimen Schlüsseln (Key1, Key2) der jeweils aktuelle Schlüssel mittels des Adreßdekoders (AD) abhängig vom adressierten Speicherbereich wählbar ist.
The semiconductor memory device of claim 1, wherein when a match between the address bits and an address of a faulty memory cell in the list occurs, then the redundant controller disables the address decoder and enables the redundant address decoder.
Halbleiterspeicherbauelement nach Anspruch 1, wobei der redundante Controller beim Auftreten einer Übereinstimmung zwischen den Adressbits und einer Adresse einer fehlerhaften Speicherzelle in der Liste den Adressdecoder deaktiviert und den redundanten Adressdecoder aktiviert.
A memory according to claim 1 or 2, wherein the address decoder means (101,107,109) comprises a column decoder (107) and a row decoder (109).
The system of Claim 6, wherein the memory includes an address decoder, and wherein the converging means is functionally merged with the address decoder to selectively activate a single one of a plurality of decoder outputs.
System nach Anspruch 6, wobei der Speicher einen Adressendecoder aufweist und wobei das Umwandlungsmittel mit dem Adressendecoder funktionell vermischt ist zum selektiven Aktivieren eines einzelnen Ausgangs einer Anzahl Decoderausgänge.
The device of Claim 3, wherein the address decoder (220) decodes an address of a location of the memory device (142) when the microprocessor (202) attempts to access the location in order to determine if the location is a valid location.
Vorrichtung nach Anspruch 3, worin der Adressendekoder (220) eine Adresse von einer Stelle der Speichereinrichtung (142) dekodiert, wenn der Mikroprozessor (202) einen Zugriff auf die Stelle versucht, um festzustellen, ob die Stelle eine gültige Stelle ist.
The method disclosed provides that at least one data register is provided in a logic module (10), the addresses recognized by the address decoder (18) being written into said data register.
Bei dem vorgestellten Verfahren ist vorgesehen, dass in einem logischen Baustein (10) mindestens ein Datenregister vorgesehen ist, in das von dem Adressdecoder (18) erkannte Adressen geschrieben werden.
Apparatus of claim 3 characterized in that the address decoder (110) includes means (115) for disabling the pin address decoder (110) whenever the participate register (150) is enabled.
Gerät nach Anspruch 3, dadurch gekennzeichnet, daß der Adressdekoder (110) Mittel (115) umfaßt für das Sperren des Stiftadressdekoders (110) immer dann, wenn das Teilnehmerregister (150) entsperrt ist.
A method of individually powering-up unsingulated dies on a semiconductor wafer, according to claim 1, further comprising: providing means responsive to an e-beam probe for providing the multi-bit address signal to the address decoder circuits (510; 510a, 510b).
Verfahren zur individuellen Stromversorgung von Chips auf einem Halbleiterwafer vor dem Teilvorgang nach Anspruch 1, ferner umfassend: Vorsehen eines Mittels, das auf eine Elektronenstrahlsonde anspricht, zum Liefern des Mehrbit-Adreßsignals zu den Adressendecodierschaltungen (510; 510a, 510b).
Andere resultaten
An integrated circuit memory according to claim 1, wherein the address decoders are connected such that all address lines except one are alternated between successive decoders.
Circuit arrangement according to claim 5, characterised in that, to the address decoders (ADC1, ADC2), there is connected an exclusive-OR element (EXO) which, when the output signals of the address decoders are not the same, emits a fault signal.
Schaltungsanordnung nach Anspruch 5, dadurch gekennzeichnet , daß an die Adressendecoder (ADC1, ADC2) ein Antivalenzglied (EXO) angeschlossen ist, das, wenn die Ausgangssignale der Adressendecoder antivalent sind, ein Fehlersignal abgibt.
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